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[디지털 논리회로 실험] 14장. 레지스터 결과레포트

저작시기 2015.06 |등록일 2016.01.14 | 최종수정일 2017.10.17 한글파일한컴오피스 (hwp) | 3페이지 | 가격 1,000원

소개글

[디지털 논리회로 실험] 레지스터 결과레포트

목차

1. 전송제어 입력이 있는 병렬레지스터
2. 3Bit 우 방향 시프트 레지스터

본문내용

- 고찰 -
전송제어 입력은 전송여부를 제어하는 입력신호로서, 레지 스터의 입력을 출력으로 전송 혹은 유보를 결정한다. 그름 은 전송제어 입력이 있는 병렬레지스터의 회로도이다. 전송 제어 입력이 0이면 레지스터 입력이 전송되지 않으며 전송 제어 입력이 1일 때만 레지스터 입력이 전송된다. 전송제 어 입력이 0이면 멀티플렉서의 출력은 입력 I_{ 0}(플립플롭의 출력)가 되고, 플립플롭의 입력이 플립플롭의 출력과 연결되므로 CLK이 발생하면 플립플롭의 출력은 이전 값을 유지한다. 즉, 레지스터의 입력이 전송되지 않고 이전 값을 유지한다. 전송제어 입력이 1이면 멀티플렉서의 출력은 입력 I _{1}, 즉 레지스터의 입력이므로 플립플롭의 출력은 레지스터의 입력이 출력된다. 즉, 레지스터의 입력이 전송된다.

참고 자료

디지털 논리회로 실험ㅣ정준모, 이재수, 이병선, 김수인 외ㅣ대한교육문화원ㅣ2009.02.20
위키백과 [우방향 레지스터]
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