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아주대 논리회로 프로젝트1 이름학번 출력 VHDL 설계

저작시기 2009.10 |등록일 2014.10.04 | 최종수정일 2017.08.03 한글파일한글 (hwp) | 18페이지 | 가격 4,000원

소개글

아주대 논리회로 김용득교수님 A+받은 레포트입니다.
한번도 배포된적 없는 100% 창작 자료입니다.
기말프로젝트 과제입니다.
VHDL 이름학번출력 설계 관련 레포트입니다.
많은 도움 되시길 바랍니다.

목차

1. 프로젝트 문제 (설계 조건)
2. 프로젝트 문제 분석 (설계 예상 방향)
3. 소스 코드
4. Testbench 코드
5. ModelSim 프로그램을 이용한 Testbench 코드 시뮬레이션
6. XST로 합성한 RTL 회로
7. 고찰
8. 추가적인 설계 Ⅰ: 다른 방식의 설계 (입력이 ASCII CODE)
9. 추가적인 설계 Ⅱ: 다른 방식의 설계 (입력이 Integer : 십진수)

본문내용

1. 프로젝트 문제 (설계 조건)

• 하나의 입력 포트에 학번(숫자)과 이름(문자)을 입력시키면 하나의 출력 포트에 연결된 7-Segment가 원하는 숫자와 이름을 출력하도록 한다.
• 입력비트와 출력비트의 크기는 최소비트로 설계한다.
• sel 변수를 두어 sel이 1 일 때 들어오는 입력은 numeric 값으로 받아들이고 sel이 0 일 때 들어오는 입력은 alphabet 값으로 받아들인다.
• 한 번에 하나의 숫자 또는 문자를 입력받고 입력 간격은 100ns 이다.
• 숫자는 0부터9 까지의 수를 그대로 입력받는다.
• 문자는 알파벳 A~Z 그리고 공백을 포함해

2. 프로젝트 문제 분석 (설계 예상 방향)

이번 프로젝트는 VHDL 프로그램을 사용하여 입력에 자신의 학번과 이름을 넣어 7-Segment에 출력시키는 설계를 하는 것이다.
먼저 주어진 설계 조건에 따라 하나의 입력포트에 학번과 이름을 입력받아 출력을 시켜야 하는데 VHDL 에서는 type의 지정형태가 매우 중요하다. 예를 들어 입력단자의 타입을 bit로 놨다면 입력은 0과 1만 넣어야한다.

3. 소스 코드
xilinx VHDL Design Tool을 이용하여 코딩한 소스

• 소스 코드 설명

→ 위 코드에서 볼 수 있듯이 엔티티 선언부에는 학번과 이름을 입력시키는 i 입력 포트와i 로 들어오는 입력이 Numberic 인지 Charactric 인지 선택할 수 있는 sel 입력 포트와 입력에 따라 실제 7-Segment에 값을 줄 o 출력 포트를 지정해 주었다.

5. ModelSim 프로그램을 이용한 Testbench 코드 시뮬레이션

• 0 sec ~ 2200 nsec 까지의 입출력 시뮬레이션 (입력을 Binary로 표현)

7. 고찰

이번 논리회로 설계 프로젝트 과제는 자신의 학번과 이름을 하나의 입력을 통해 100ns 주기로 입력받아 하나의 출력으로 7-Segment에 나타나게 동작

참고 자료

없음
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