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아주대_논리회로실험_예비5_래치와 플립플롭

저작시기 2007.01 |등록일 2010.04.04 한글파일한글 (hwp) | 6페이지 | 가격 1,000원

소개글

실험 5. 래치와 플립플롭
(Latch & Flip-Flop)
1. 목적
여러 종류의 flip-flop을 구성하여 그 동작 특성을 알아본다.

2. 이론
◆ Flip-Flop
플립플롭은 그림 7-6에 나타낸 것과 같이 제어신호와 클럭 신호를 입력으로 갖는 기억소자로, 다양한 종류(SR, JK, D, T 플립플롭 등)가 있다. 각 플립플롭에 대한 회로 및 동작 특성을 알아보기 전에 모든 플립플롭에 적용되는 공통된 사항을 먼저 알아보자. 플립플롭은 래치와는 달리 클럭의 상승 또는 하강 모서리에 동기되어 출력 Q와 Q` 값이 변하게 된다. 이 말은 플립플롭에 입력되는 제어신호가 변하더라도 클럭이 0에서 1로 변하거나(상승 모서리) 또는 1에서 0으로 변하기(하강 모서리) 전에는 출력 Q의 값이 변하지 않는다는 뜻이다. 다시 말해 플립플롭은 클럭이 0에서 1로 변하거나 또는 1에서 0으로 변하는 시점에 맞추어 출력 값이 변하게 되며, 이 때 출력 값은 클럭이 변하는 시점에 입력되고 있던 제어신호의 값에 따라 결정된다. 결국 클럭 신호는 플립플롭의 출력이 변화되는 시점을 결정하는 역할을 하며, 제어신호는 플립플롭의 출력 값을 결정하는 역할을 수행한다고도 볼 수 있다. 만일 플립플롭이 클럭의 상승 모서리(0에서 1로 변하는 시점)에 맞추어(동기되어) 출력 값이 변하도록 만들어 졌다면 이 플립플롭은 상승 모서리 트리거 방식 플립플롭(positive-edge triggered flip-flop)이라고 말한다. 반대로 클럭의 하강 모서리(1에서 0으로 변하는 시점)에 맞추어 출력 값이 변하도록 만들어 졌다면 이 플립플롭은 하강 모서리 트리거 방식 플립플롭(negative-edge triggered flip-flop)이라고 말한다. 상승 모서리 트리거 방식 플립플롭과 하강 모서리 트리거 방식 플립플롭은 출력 값이 변하는 시점만 다를 뿐 출력의 논리 값을 결정하는 방법은 동일함으로 앞으로 플립플롭을 설명할 때는 편의상 주로 상승 모서리 트리거 방식 플립플롭을 기준으로 설명한다.

목차

1. 목적
2. 이론

본문내용

◆ Flip-Flop
플립플롭은 그림 7-6에 나타낸 것과 같이 제어신호와 클럭 신호를 입력으로 갖는 기억소자로, 다양한 종류(SR, JK, D, T 플립플롭 등)가 있다. 각 플립플롭에 대한 회로 및 동작 특성을 알아보기 전에 모든 플립플롭에 적용되는 공통된 사항을 먼저 알아보자. 플립플롭은 래치와는 달리 클럭의 상승 또는 하강 모서리에 동기되어 출력 Q와 Q` 값이 변하게 된다. 이 말은 플립플롭에 입력되는 제어신호가 변하더라도 클럭이 0에서 1로 변하거나(상승 모서리) 또는 1에서 0으로 변하기(하강 모서리) 전에는 출력 Q의 값이 변하지 않는다는 뜻이다. 다시 말해 플립플롭은 클럭이 0에서 1로 변하거나 또는 1에서 0으로 변하는 시점에 맞추어 출력 값이 변하게 되며, 이 때 출력 값은 클럭이 변하는 시점에 입력되고 있던 제어신호의 값에 따라 결정된다. 결국 클럭 신호는 플립플롭의 출력이 변화되는 시점을 결정하는 역할을 하며, 제어신호는 플립플롭의 출력 값을 결정하는 역할을 수행한다고도 볼 수 있다. 만일 플립플롭이 클럭의 상승 모서리(0에서 1로 변하는 시점)에 맞추어(동기되어) 출력 값이 변하도록 만들어 졌다면 이 플립플롭은
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