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테브난-노턴 등가회로

저작시기 2008.05 |등록일 2009.01.01 한글파일한컴오피스 (hwp) | 6페이지 | 가격 1,000원

소개글

테브난 정리와 노턴정리의 등가회로 이해하기

목차

1. 실험 목적
2. 이 론
3. 실험 장비
4. 실험 방법

본문내용

1. 실험 목적
• 회로분석에 많이 사용되는 테브난과 노턴의 등가회로를 이해하고 그 운용 방법을 이해한다.
• 테브난 정리 노튼 정리를 실험적으로 증명한다.
2. 이 론
회로를 해석하다 보면 단일 가지에 흐르는 전류 또는 전압을 구하는 경우가 많다. 한 가지의 전류 또는 전압을 구하기 위하여 루프 방정식 또는 마디 방정식을 세워 연립방정식 푼다. 이 경우에 등가 회로에 관한 Thevenin의 정리와 Norton의 정리를 이용하면, 매우 편리하다
Thevenin의 정리란 전원을 포함하는 선형능동회로망을 출력 단자 a, b 외측에 대해서는 이것을 등가적으로 단자 a, b 를 개방했을 때 나타나는 전압 V와 회로망내의 모든 전원을 제거하고 단자 a, b 에서 본 회로망의 등가 임피던스 Ze와 직렬로 연결된 단일 등가 전압원으로 대치시킬 수 있는 것이다.
임피던스 Ze는 출력 단자서 본 회로망의 등가 임피던스로서 출력단자를 개방하고, 회로망에 내포된 모든 전압전원을 단락, 모든 전류전원을 개방시키고 출력단자에서 본 수동 회로망의 구동점 임피던스(driving point impedance)를 말한다. 단일 등가 전압원은 출력 단자를 개방하고 출력 단자에서 측정한 전압의 크기와 같고, 극성은 원래의 전원에 의한 전류의 방향과 일치하도록 한다. Thevenin의 정리가 적용되기 위한 회로의 조건은 출력 단자에 있는 회로 소자가 회로망 내부에 있는 회로 소자와 자기적으로 결합되어 있지 않아야 한다.
아래 등가전압 전원 Vth는 이 두 단자를 개방시킬 때 나타나는 두 단자 사이의 전압과 같고 등가저항 Rth는 두 단자 사이의 모든 전원을 그 내부 저항으로 대치시킬 때 나타나는 두 단자 사이의 합성 저항과 같다.

참고 자료

없음
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