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'논회실' 총 검색 결과 2,107건
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[아주대]논회실 결과3
- 실험3. 가산기 & 감산기 1. 실험과정 및 결과 <반가산기 회로도> <반가산기 회로결손도> <반가산기 실험 회로> (1) 반가산기(half adder : HA) <반가산기 예상결과>입 력 출 력 X Y S C 0 0 0 0 0 1 1 0 1 0 1 0 1 1 0 1 ..
- 리포트 > 공학/기술|2014.09.04|4페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 실험8 결과보고서
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결과보고서. 1. 첫 번째 실험, 2단 2진 Counter ? 비동기식 Counter 1) 실험과정 및 결과 ? 74HC00과 74HC96 이용하여, 2단 2진 Counter ? 비동기식 Counter를 만든다. 2) 고찰 디코더 역할을 하는 AND GATE
- 리포트 > 공학/기술|2014.03.10|4페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험1 예비보고서
- 1. 실험목적 1) Logic gates의 이해 2) Logic 회로 구성 법칙의 이해 3) Boolean equation의 이해 4) De Morgan의 법칙 이해 2. 실험이론 1) Logic gate란? 1개 또는 2개 이상의 입력신호를 받아 단 1개의 출력신호를..
- 리포트 > 공학/기술|2014.03.10|3페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 실험1 결과보고서
- 결과보고서. 1. 실험과정 및 결과 실험1. 3-input AND gate. 실험1 사진 <3-input AND gate>INPUT OUTPUT A B C L1 L2 0 0 0 0 0 0 0 1 0 0 0 1 0 0 0 0 1 1 0 0 1 0 0 0 0 1 0 1 0..
- 리포트 > 공학/기술|2014.03.10|4페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험7 결과보고서
- 결과보고서. 실험 1) 6bit shift Right Register 1) 실험과정 및 결과 (CLR=0, PRE1,2=1, 을 넣었을때는 CLR셋이 active 상태이므로 켜지지 않는다.? 74HC00과 74HC76 이용하여, 6bit shift Right Regis..
- 리포트 > 공학/기술|2014.03.10|4페이지|1,500원|구매(0)|조회(0)
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[아주대]논회실 결과 실험9. 램 (RAM)
- 실험9. 램 (RAM) 3. 실험방법 및 예상결과 <실험1 예상 결과>Read Write A B QE 0 QE 1 IN 0 IN 1 WR 1 WR 0 Output Input 1 0 1 0 0 1 0 0 1 0 1 0 1 0 1 0 0 1 0 1 0 1 0 0 0 1 0..
- 리포트 > 공학/기술|2014.09.04|3페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 실험9 예비보고서
- 1. 실험목적 반도체 memory의 기본적인 동작 원리를 알아보고 64-bit 기억 소자의 동작을 실험을 통해 확인한다. 2. 실험이론 1) RAM이란? RAM은 정보를 저장하거나 저장된 정보를 읽어낼 수 있는 기억장치를 말한다. 일반적으로 기억장치는 주소(addre..
- 리포트 > 공학/기술|2014.03.10|4페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 실험5 결과보고서
- 체계로 나타낼 수 있는 조합회로이다. 실제로 실험한 결과 옆에 있는
- 리포트 > 공학/기술|2014.03.10|4페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험2 결과보고서
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결과보고서. 실험1. Inverter의 입출력 특성 확인 1) 실험 과정 및 결과
H로 갈 때 변화하는 값이다.> <그림2><그림1><7404의 파라미터값> 2) 고찰 이번 실험의 목적은 슈미트 인버터와 비교하기 위해 XY파형 분석으로 입출력특성 그래프를 그려보.. - 리포트 > 공학/기술|2014.03.10|5페이지|1,500원|구매(0)|조회(0)
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[아주대 논회실] 논회실 결과보고서 1
- 실험1. Basic Gates 1. 실험 과정 및 결과(결과값, 이론값, 시뮬레이션 비교, 원인분석) [1] 실험 1 1) 3-input AND Gate - 74HC04 (AND gate)소자에 입력값을 pin number 1A, 1B에 연결하고 출력값 1Y를 다시 입..
- 리포트 > 공학/기술|2015.01.09|5페이지|1,700원|구매(0)|조회(0)
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[아주대]논회실 예비 실험1. Basic Gates
- 1 1 1 1 회로결손도 2012-2 박성진 교수님 논리회로 강의노트
- 리포트 > 공학/기술|2014.09.04|6페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 실험3 결과보고서
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결과보고서. 실험2. Full adder(전가산기) 1) 실험과정 및 결과 (x=S, y=C) ※ S는 합(sum)을 나타내고 C는 올림수(carry)를 나타낸다. 이때 불린 equation에서 ?는 XOR게이트를 뜻한다.
- 리포트 > 공학/기술|2014.03.10|4페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험10 결과보고서
- 결과보고서. 1. 첫 번째 실험, DAC (digital analog converter) 1) 실험과정 및 결과 <회로 구성 모습> <회로도>? 74HC90과 74HC04, 74HC05 741을 이용하여 회로도를 구성한다. <카운터가 클리어 되고 싱글 펄스를 입력하게 ..
- 리포트 > 공학/기술|2014.03.10|5페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험4 결과보고서
- 결과보고서. 실험1. Multiplexer 1) 실험과정 및 결과 ? 74HC20과 74HC04를 이용하여 Multiplexer 만들기. <실험결과 Truth Table><74HC20, 74HC04를 이용해서 만든 먹스 회로><=1 =1 E=0 =0 =0 =0 =1을 ..
- 리포트 > 공학/기술|2014.03.10|4페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험6 결과보고서
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결과보고서. 실험1. Latch with Enable 1) 실험과정 및 결과 ? 74HC00을 이용하여, Enable 값을 갖는 Latch를 만든다.
- 리포트 > 공학/기술|2014.03.10|5페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험5 예비보고서.hwp
- HE는 다른 부호체계를 그에 상응하는 2진수로 고쳐주는 조합회로이다
- 리포트 > 공학/기술|2014.03.10|4페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 실험6 예비보고서.hwp
- 회로는, 클럭파형을 알아서 클럭 디텍터도 해주므로, 회로가 값을 결정하게
- 리포트 > 공학/기술|2014.03.10|4페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 실험9 결과보고서
- 결과보고서. 1. 첫 번째 실험, 2-bit RAM 1) 실험과정 및 결과 <회로도><회로 구성 모습>? 74HC00을 이용하여 R-S latch를 2개 구성하고 입력과 출력부분에 DEMUX를 구성하여 선택된 비트의 래치에 정보가 저장되도록 구성한다. 그 후에 IN핀을..
- 리포트 > 공학/기술|2014.03.10|4페이지|1,500원|구매(0)|조회(0)
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아주대 논회실 실험10 예비보고서.hwp
- 1. 실험목적 D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다. DAC : digital 신호를 analog 신호로 변환해주고 ADC : analog 신호를 digital 신호로 변환해준다 2. 실험이론 (1) D/A 및 A/D C..
- 리포트 > 공학/기술|2014.03.10|5페이지|1,000원|구매(0)|조회(0)
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아주대 논회실 논리회로실험 실험7 결과보고서
- 1. 실험 과정 및 결과 -실험결과 기록 및 정리 - 6bit Shift Right Register 위 회로를 브레드보드에 구현한 결과 PR1,2=0 Serial Data=0 CLR=0 PR1,2=1 CLR=1 클럭 인가 Serial Data=1 실험결과가 예비보고서의..
- 리포트 > 공학/기술|2014.04.08|6페이지|1,500원|구매(0)|조회(0)
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